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搜索资源列表

  1. uart

    0下载:
  2. 串口通信的接收和发送数据的verilog编程,对每条语句有详细说明其实现的功能。
  3. 所属分类:串口编程

    • 发布日期:2010-11-19
    • 文件大小:484481
    • 提供者:yiyi1223
  1. uart verilog

    0下载:
  2. 串口verilog UART,源码;串口verilog UART,源码
  3. 所属分类:网络编程

    • 发布日期:2012-07-04
    • 文件大小:6041
    • 提供者:malesky@163.com
  1. SPI-in-Verilog-implementation

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  2. SPI的Verilog实现(非常的全面和详细,还带有SPI算法的注解).-SPI in Verilog implementation (a very full and detailed, but also with the SPI algorithm annotation).
  3. 所属分类:Communication

    • 发布日期:2017-03-23
    • 文件大小:7831
    • 提供者:尚林
  1. UART

    0下载:
  2. 自己实用Verilog编写的UART程序,1位开始位,8位数据位,1位停止位,本测试程序配置完管脚后,实用串口大师发送数据,则返回数据为发送数据+1-Verilog prepared their own UART practical procedures to start a bit, 8 data bits, 1 stop bit, the test procedure End pin configuration, the utility serial Master to send data,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:254213
    • 提供者:张键
  1. UART_spec

    0下载:
  2. a UART model with FIFO buffer, design with verilog
  3. 所属分类:Communication

    • 发布日期:2017-03-28
    • 文件大小:144964
    • 提供者:quang
  1. 基于VERILOG的uart应用

    0下载:
  2. 介绍了在FPGA板上的串口调试实验,用verilog语言写的,在NEXYS3板上调试成功
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-12
    • 文件大小:287379
    • 提供者:qiusuo123
  1. UART

    0下载:
  2. 利用Verilog实现UART收发数据功能-Verilog UART send and receive data functions to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1195901
    • 提供者:高柯
  1. my_uart1_VERILOG_using-PLL

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  2. Verilog uart example, RS232的Verilog例子。PC 发送一个字节(byte)到板子(FPGA),板子回发一个(byte+1).例子简洁,有注释。用到PLL,而且有3:2次数据采用-Verilog uart example,Verilog RS232 example,it s easy to understand, PC send 1 Byte RS232 code to FPGA, FPGA return 1 tht code,but Byte+1, Using P
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:507349
    • 提供者:林端
  1. Uart

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  2. fpga verilog语言,写的串口通讯,经测试完全没有问题-fpga verilog uart communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1988650
    • 提供者:孙祥龙
  1. verilog--uart

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  2. verilog实现uart功能的FPGA应用,适用于Cyclone 2系列-verilog uart function of FPGA applications in the Cyclone Series
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:87898
    • 提供者:sunlin
  1. verilog

    0下载:
  2. verilog HDL 入门学习的源代码。 包括双向语法,计数器,状态机,锁存器,uart等-Introduction to learning verilog HDL source code. Including two-way grammar, counters, state machines, latches, uart, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:3319
    • 提供者:鲁东
  1. Verilog-UART

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  2. 功能:UART串口通讯实信实验 描述:本程序共四个模块 模块1:接收数据的波特率发生模块,接收模块在接收到下降沿时,通过标志位启 动该模块的波特率计数器,并在计数中返回一个采样标志位给接受模块, 通知接收模块采样; ---------------------------------------------------------------------- 模块2:数据接收模块,该模块一旦监测到数据输入端有下降沿,就立即启动波 特率(标志位置1),并使
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-06
    • 文件大小:16375
    • 提供者:mrmu
  1. UART

    0下载:
  2. uart 的verilog源码,希望对大家有用!(UART Verilog source hope useful for all!)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:1024
    • 提供者:qcleo
  1. uart

    0下载:
  2. UART的串口程序,收发功能都已实现,直接可用(UART serial procedures, transceiver functions have been achieved, directly available)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:2048
    • 提供者:上腾娱乐
  1. verilog uart v1.0

    0下载:
  2. 基于Verilog语言写的UART模块,非常实用,可以参考,希望共同进步(Based on the Verilog language to write the UART module, very practical, you can refer to, hope to make progress together)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:2847744
    • 提供者:骑士1234
  1. uart

    0下载:
  2. 用Verilog实现FPGA的uart的串行通信功能,并附有testbench(The serial communication function of FPGA of UART is realized with Verilog, and Testbench is attached)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-02
    • 文件大小:308224
    • 提供者:怪了个乖
  1. uart

    0下载:
  2. FPGA Verilog设计UART通讯程序(UART communication code with Verilog in FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-10
    • 文件大小:117760
    • 提供者:gq_zhou
  1. UART

    0下载:
  2. 本人用verilog编写的UART协议,经测试可用。(I am prepared to use verilog UART protocol, the test is available.)
  3. 所属分类:VHDL/FPGA/Verilog

  1. uart_fifo_n

    0下载:
  2. verilog 带fifo的串口收发模块(verilog uart with fifo)
  3. 所属分类:其他

    • 发布日期:2018-04-29
    • 文件大小:7583744
    • 提供者:yxsheron
  1. uart

    0下载:
  2. UART接口的基于FPGA芯片,用Verilog语言实现,在quartus上操作(UART interface is implemented by FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

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